DS21352

3.3V DS21352および5V DS21552 T1シングルチップトランシーバ


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説明

The DS21352/552 T1 single chip transceiver contains all of the necessary functions for connection to T1 lines whether they are DS1 long haul or DSX-1 short haul. The clock recovery circuitry automatically adjusts to T1 lines from 0 feet to over 6000 feet in length. The device can generate both DSX-1 line build outs as well as CSU line build-outs of -7.5dB, -15dB, and -22.5dB. The onboard jitter attenuator (selectable to either 32 bits or 128 bits) can be placed in either the transmit or receive data paths. The framer locates the frame and multiframe boundaries and monitors the data stream for alarms. It is also used for extracting and inserting robbed-bit signaling data and FDL data. The device contains a set of internal registers which the user can access and control the operation of the unit. Quick access via the parallel control port allows a single controller to handle many T1 lines. The device fully meets all of the latest T1 specifications including ANSI T1.403-1995, ANSI T1.231-1993, AT&T TR 62411 (12-90), AT&T TR54016, and ITU G.703, G.704, G.706, G.823, and I.431.
DS21352、DS21552:ピン配列 DS21352、DS21552:ピン配列 拡大表示+

主な特長

  • Complete DS1/ISDN-PRI/J1 transceiver functionality
  • Long and Short haul LIU
  • Crystal-less jitter attenuator
  • Generates DSX-1 and CSU line build-outs
  • HDLC controller with 64-byte buffers Configurable for FDL or DS0 operation
  • Dual two-frame elastic store slip buffers that can connect to asynchronous backplanes up to 8.192MHz
  • 8.192MHz clock output locked to RCLK
  • Interleaving PCM Bus Operation
  • Per-channel loopback and idle code insertion
  • 8-bit parallel control port muxed or nonmuxed buses (Intel or Motorola)
  • Programmable output clocks for Fractional T1
  • Fully independent transmit and receive functionality
  • Generates/detects in-band loop codes from 1 to 8 bits in length including CSU loop codes
  • IEEE 1149.1 JTAG-Boundary Scan
  • Pin compatible with DS2152/54/354/554 SCTs
  • 100-pin LQFP package (14 mm x 14 mm) 3.3V (DS21352) or 5V (DS21552) supply; low power CMOS

技術資料

アプリケーションノート 3760 Interleaved Bus Operation
アプリケーションノート 3547 T3/E3/STS-1 LIU上でのリターンロスの測定
アプリケーションノート 3349 マキシムT1/E1/J1トランシーバのT1/E1ループバック動作
アプリケーションノート 3208 Elastic Store Operation
アプリケーションノート 3121 Selecting a T1/E1/J1 Single-Chip Transceiver
アプリケーションノート 2713 Switching Frame Mode In Live T1 Systems
アプリケーションノート 461 Programming and Controlling the FDL on DS2141A, DS2151
アプリケーションノート 405 Power-Fault Protection Layout
アプリケーションノート 394 HDLC Configuration of Framers and Transceivers
アプリケーションノート 391 NRZ Applications
アプリケーションノート 388 Hitless Protection Switching with 1+1 Redundancy
アプリケーションノート 382 J1 Japanese Standards
アプリケーションノート 381 Interfacing the DS2155 to the MPC8260
アプリケーションノート 379 Conversion Between T1 and E1
アプリケーションノート 370 Using RCLK in a BITS/SSU Application
アプリケーションノート 360 DS21352/DS21552 versus DS2152 Single Chip Transceiver
アプリケーションノート 355 DS21Q4x, DS215x, and DS21x5y Test Registers
アプリケーションノート 351 T1/E1 and T3/E3 Transformer Selection Guide
アプリケーションノート 345 DS21352/552, DS2151, DS2152, DS2141A, DS21Q42 Programming SLC-96
アプリケーションノート 342 T1/E1 Framer Initialization and Programming
アプリケーションノート 337 DS2151 Implementation of ANSI T1.231-1993
アプリケーションノート 336 Transparent Operation on T1, E1 Framers and Transceivers
アプリケーションノート 325 DS2151, DS2152, DS2153, DS2154 Dallas Single Chip Transceiver Crystal Selection Guide
アプリケーションノート 324 T1/E1 Network Interface Design
アプリケーションノート 319 DS2152, DS2154, DS21x5Y, and DS2155 Interfacing to the MC68360 (QUICC32)
アプリケーションノート 310 D4 Framing and Signaling
アプリケーションノート 309 Interfacing to the Fractional T1 and E1
アプリケーションノート 307 DS2152, DS2154, DS2151, DS2153, DS21X5Y and DS2155 Three Channel Drop and Insert

品質および環境データ

製品の信頼性レポート: DS21352.pdf 
鉛フリーパッケージの錫(Sn)のウィスカレポート

その他リソース

評価キット

CAD Symbols and Footprints

  • DS21352L+
  • DS21352LB+
  • DS21352LN+
  • デバイス   ウェハープロセス   プロセス技術   サンプルサイズ   不合格   FIT (25°C)   FIT (55°C)  

    注: 不良率はプロセス技術ごとにまとめられ、関連する型番にマッピングされます。 不良率はテストされたユニット数に大きく依存します。

    品質管理システム >
    環境管理システム >

     
    Status:
    Package:
    Temperature:

    関連リソース


    MAX5871
    16ビット、5.9Gsps補間および変調RF DAC、JESD204Bインタフェース内蔵

    • RF設計を簡素化し新しいワイヤレス通信アーキテクチャを実現
    • ダイレクトRF合成:帯域幅600MHz、最大2.8GHz
    • 高い柔軟性と設定自由度


    種類 ID PDF タイトル
    アプリケーションノート 3760 Interleaved Bus Operation
    アプリケーションノート 3547 T3/E3/STS-1 LIU上でのリターンロスの測定
    アプリケーションノート 3349 マキシムT1/E1/J1トランシーバのT1/E1ループバック動作
    アプリケーションノート 3208 Elastic Store Operation
    アプリケーションノート 3121 Selecting a T1/E1/J1 Single-Chip Transceiver
    アプリケーションノート 2713 Switching Frame Mode In Live T1 Systems
    アプリケーションノート 461 Programming and Controlling the FDL on DS2141A, DS2151
    アプリケーションノート 405 Power-Fault Protection Layout
    アプリケーションノート 394 HDLC Configuration of Framers and Transceivers
    アプリケーションノート 391 NRZ Applications
    アプリケーションノート 388 Hitless Protection Switching with 1+1 Redundancy
    アプリケーションノート 382 J1 Japanese Standards
    アプリケーションノート 381 Interfacing the DS2155 to the MPC8260
    アプリケーションノート 379 Conversion Between T1 and E1
    アプリケーションノート 370 Using RCLK in a BITS/SSU Application
    アプリケーションノート 360 DS21352/DS21552 versus DS2152 Single Chip Transceiver
    アプリケーションノート 355 DS21Q4x, DS215x, and DS21x5y Test Registers
    アプリケーションノート 351 T1/E1 and T3/E3 Transformer Selection Guide
    アプリケーションノート 345 DS21352/552, DS2151, DS2152, DS2141A, DS21Q42 Programming SLC-96
    アプリケーションノート 342 T1/E1 Framer Initialization and Programming
    アプリケーションノート 337 DS2151 Implementation of ANSI T1.231-1993
    アプリケーションノート 336 Transparent Operation on T1, E1 Framers and Transceivers
    アプリケーションノート 325 DS2151, DS2152, DS2153, DS2154 Dallas Single Chip Transceiver Crystal Selection Guide
    アプリケーションノート 324 T1/E1 Network Interface Design
    アプリケーションノート 319 DS2152, DS2154, DS21x5Y, and DS2155 Interfacing to the MC68360 (QUICC32)
    アプリケーションノート 310 D4 Framing and Signaling
    アプリケーションノート 309 Interfacing to the Fractional T1 and E1
    アプリケーションノート 307 DS2152, DS2154, DS2151, DS2153, DS21X5Y and DS2155 Three Channel Drop and Insert